altera

verilog～整数から浮動小数点へ変換とその逆も～

2020.05.20
Quartus verilog
altera, double, float, int, quartus, verilog, 変換, 整数, 浮動小数点

はじめにこんにちは、keymaleです。python記事をいくら書いても全く閲覧数が増えず、verilog関係の記事ばかり閲覧数が増えています。あとなぜか育児日記が最近閲覧数が増えています。そんなこんなで今回は久しぶりにverilogの記事を書こうと思ったわけです。FPGAで浮動小数点の演算をしようと思ったのですが、調べても情報が古かったり、結局どうしたらいいかわからなかったのですが、解決できた […]

verilog～UART通信受信機(RX)編～

2019.06.05
Quartus verilog
altera, FPGA, intel, MAX10, quartus, RS232, RX, UART, verilog, verilog HDL, ボーレート, やり方, 入門, 初心者, 受信機, 通信, 通信規格

初めにお久しぶりです、Keymaleです。先週はUARTの送信機について紹介しました。結構検索して見ていただいたみたいなので、今回は受信機のほうを紹介していきます。受信機のコード内に分周器が出てきますが、詳細は過去記事を見てください。 UART規格規格についても詳細はこちらを見てください。通信レート（ボーレート）は9600, 19200, 38400, 76800, 115200 bpsなど […]